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有些人說"用C(behavioral-level)的方式去寫Verilog(gate-level)會令人想哭",這句話有些情況是這樣沒錯。但把這句反過來,也一樣會讓人想哭:"用gate-level的方式去 ... ... <看更多>
verilog 入門 書 ptt 在 【請益】 硬體描述語言真的很難~~ - Electronics板 - PTT網頁版 的推薦與評價
小弟現在自學verilog,雖然爬過前面的文,也知道c與verilog是不一樣的,但是個人努力的結果,還是覺得很難用語法寫出想要的功能,這是否表示個人的 ... ... <看更多>
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我平常用的是VHDL語言,並使用Xilinx ISE作為開發環境。
最近我想使用Verilog語言來撰寫,請問有適合的入門書籍推薦嗎??
當初使用VHDL是因為學長都用這種語言,可是業界好像都用Verilog,
於是想開始自學將語法改為Verilog。 可以順便問一下Verilog 與 VHDL 語法上的差別?
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